Verilog问题答疑（20）时序电路/时序电路+组合逻辑写法分析

Yvonne 2022-04-02 FPGA 0 Comments

这两种设计有什么区别，哪个才更合适。

第一种是第一张图片的设计，组合逻辑+时序逻辑：

第二种是经常写的直接一个时序逻辑：

Verilog运算符优先级：

对应视频：

Verilog问题答疑（20）时序电路/时序电路+组合逻辑写法分析–视频教程

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